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20. 下列关于USB总线特性的描述,错误的是( )

A 可实现外设的即插即用和热插拔 B 是一种通信总线,连接不同外设 C 可通过级联方式连接多台外设 D 同时可传输2位数据,数据传输率高 21. “总线忙”的建立者是( )

A 总线控制器 B CPU C 获得总线控制权的设备 D 发出“总线请求”信号的设备

22. 采用无压缩方式传输一张分辨率为640x480像素,65535色的照片,设有效数据传输率为56kbit/S,大约需要的时间是( )

A 34.82 B 43.86 C 85.71 D 87.77

23. 某总线支持二级cache块传输方式,若每块6个字,每字长4B,时钟频率100MHZ,当读操作时,第一个时钟周期接受地址,第二、三个时钟周期为延时周期,另外用4个时钟周期传输一个块,则读操作的总线传输率为( )

24. 三态缓冲门可组成运算器的数据总线,它的输出电平有逻辑“1 ”、逻辑“0 ”、浮空三种状态。 25. 译码器是一种组合逻辑电路,而计数器是一种时序逻辑电路。

26. 大多数微型机的总线由地址总线、数据总线和控制总线组成,因此,它们是三总线结构的。

第四章

1. 计算机系统的三级存储器结构指的是 ① 、 ② 和 ③ 。

2. 在多级存储体系中,cache的主要功能是 ① ,虚拟存储器的主要功能是 ② 。

3. 对存储器的要求是 ① , ② , ③ 。为了解决这三个方面的矛盾,计算机采用多级存储器体系结构。 4. 虚拟存储器通常由主存和 ① 两级存储系统组成。为了在一台特定的机器上执行程序,必须把 ② 映像到这台机器主存储器的 ③ 空间上,这个过程称为地址映像。

5. cache是一种 ① 存储器,是为了解决CPU和主存之间 ② 不匹配而采用的一项重要的硬件技术,现发展为 ③ 体系, ④ 分设体系。

6. 程序访问的局限性是使用( )的依据。 A. 缓冲 B. cache C. 虚拟内存 D. 进程 7.下列有关存储器的描述中,不正确的是______。

A. 多体交叉存储器主要解决扩充容量问题 B. 访问存储器的请求是由CPU发出的 C. cache与主存统一编址,即主存空间的某一部分属于cache D. cache的功能全由硬件实现 8. 为使虚存系统有效地发挥其预期的作用,所运行的程序应具有的特性是( ) 。

A. 该程序不应含有过多的I/O操作 B. 该程序的大小不应超过实际的内存容量 C. 该程序应当具有较好的局部性 D. 该程序的指令相关不应过多

9. 在cache和主存的二级存储体系中,主存与cache同时访问,cache的存取时间是100ns,主存为1000ns,如果希望有效(平均)

存取时间不超过cahce存储时间的115%,则cache的命中率至少应该为( ) 。 A. 90% B. 98% C. 95% D. 99% 10. DRAM的刷新是以( )为单位的。

A. 集中刷新 B.分散刷新 C.异步刷新 D. 都不对

11. 假定用若干2Kx4位的芯片组成一个8Kx8位的存储器,则地址0B1FH所在芯片的最小地址是( )。 A. 0000H B. 0600H C. 0700H D. 0800H

12. 某计算机字长为16位,存储器容量为256KB,CPU按字寻址,其寻址范围是( )。 A. 0~2-1 B. 0~2-1 C. 0~2-1 D. 0~2-1

13. 已知单体存储器的T为110ns,总线传输周期为10ns,则当采用低位交叉的多模块存储器时,存储体数应( )。

A. 大于11 B. 等于11 C. 小于11 D. 大于等于11

14. 在高速缓冲系统中,主存容量为64MB,cache为512KB,则该存储系统的容量为( )。 A. 64MB+512KB B. 64MB C. 64MB~64MB+512KB D. 64MB-512KB

15. 在计算机中,存储器是数据传送的中心,但访问存储器的请求是由CPU或I/O所发出的。

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16. 为什么要把存储系统细分成若干个级别?目前微机的存储系统中主要有哪几级存储器?各级存储器是如何分工的?

17. 计算机存储系统分哪几个层次?每一层次主要采用什么存储介质?其存储容量和存取速度的相对关系如何?

18. 提高存储器速度可采用哪些措施,请说出至少五种措施。

19. 存储器系统的层次结构可以解决什么问题?实现存储器层次结构的先决条件是什么?用什么度量?

1.下列选项中,能引起外部中断的事件是( ) A.键盘输入 B.除数为0 C.浮点运算下溢 D.访存缺页

2.单级中断系统中,中断服务程序内的执行顺序是( )

I.保护现场 II.开中断 Ⅲ,关中断 Ⅳ.保存断点 v.中断事件处理 Ⅵ.恢复现场 Ⅶ.中断返回

A. I—V一Ⅵ一II一Ⅶ B.Ⅲ一I—V一Ⅶ