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数据缓存，存储器管理单元(MMU),和其他ARM子系统功能.寄存器的CP15 使用MRC的编程和MCR ARM指令，当在特权模式下，如ARM公司 主管或系统模式.
3.4.3 MMU
一二级页表存储在主存储器单套用于控制地址转换， 权限检查和内存区域的属性数据和指令访问.该MMU uses一 一个统一的翻译后备缓冲区(TLB)缓存在页表掌握的信息.该 MMU特点是：
标准的ARM架构v4和v5 MMU映射的大小，域和访问保护方案. 测绘尺寸是： – 1MB（段） – 64KB（大页） – 4KB（小页） – 1KB（小页）
大页面和小网页的访问权限可以单独指定每个季度 该页面（子页面的权限） Hardware page table walks 整个TLB,无效使用CP15 寄存器 8 无效TLB项，由MVA,选择使用CP15 寄存器 8 锁定的TLB项，使用CP15 寄存器 10
3.4.4
高速缓存和写缓冲器
该指令的高速缓存的大小是16KB,数据高速缓存16KB.此外，缓存有以下 特点：
虚拟索引，虚拟标记，并采用修正的解决虚拟地址(MVA)
4路组相联，与一个八个字缓存行，每行，每行(32-bytes长度），并与 两脏bits在Dcache
Dcache支持直写和回写（或复制回）缓存的操作，按内存选择 地区使用在C转换表的B和bits MMU 关键单词的第一个缓存加气站
缓存锁定寄存器使控制哪些缓存ways是分配用于行填充， 同时提供一个锁定机制，控制缓存腐败
Dcache存储物理地址TAG（每年TAG）的对应每个条目在标记Dcache 内存高速缓存行期间写的挫折，除了在存储到虚拟地址标签的使用 标签RAM.这意味着MMU不Dcache写回行动的，删除 可能错过的TLB相关的回写地址.
缓存失效维修业务提供高效的，整个Dcache或Icache，地区 在Dcache或Icache，和虚拟内存区域.
写缓冲区用于所有写入noncachable bufferable地区，写，写通过区域 门柱回写的地区.一个单独的缓冲区纳入Dcache举行写回
高速缓存行驱逐或脏缓存行清洗.主要写缓冲区有16-word数据缓冲区和一 四个地址的缓冲区.该Dcache回写数据字有八个项目和一个地址表项
3.4.5
先进的高性能总线 (AHB)
ARM的子系统uses的AHB ARM926EJ-S端口连接到配置了ARM和总线 外部存储器.仲裁者是聘请独立的仲裁获得了由D-AHB和I-AHB 配置总线和总线外部存储器.
3.4.6
嵌入式跟踪宏单元(ETM)和嵌入式跟踪缓冲区(ETB)
为了支持实时跟踪，ARM926EJ-S处理器提供了一个接口，使一个连接 嵌入式跟踪宏单元(ETM).中ARM926ES-J OMAP-L138子系统还包括 嵌入式跟踪缓冲区(ETB).的ETM由两部分组成： 跟踪端口提供了实时跟踪能力的ARM9.
触发器触发设施提供资源，其中包括地址和数据比较器，计数器， 和音序器.
跟踪端口的OMAP-L138不固定了，是不是只能连接到嵌入式跟踪缓冲区. 该ETB有4KB缓冲存储器. ETB启用调试工具是必需的读/捕获的解释 跟踪数据
3.4.7
ARM存储器映射
默认情况下，ARM已经获得最上和片外存储器领域，包括内部的DSP 回忆，EMIFA界面; DDR2,和额外128K字节片上共享SRAM.同样，几乎所有的 片上外设的访问默认情况下，ARM的. 见
表3-3一个详细的顶级OMAP-L138内存映射，其中包括ARM存储器空间
3.5 DSP子系统
该DSP子系统包括以下功能： C674x DSP CPU
32KB L1计划（L1P）32KB) /高速缓存（高达 32KB L1资料（L1D）32KB) /高速缓存（高达 256KB统一映射RAM /高速缓存(L2) 1MB面膜可编程ROM 小尾数
3.5.1
C674x DSP CPU描述
中央处理单元的C674x (CPU)包括八个功能单元，两个寄存器文件和两个 数据路径所示 图3-2.
这两个通用寄存器文件(A和B)每个包含
32 32-bit登记册登记的64总计.在通用寄存器可用于数据或可
数据地址指针.支持的数据类型包括包装8-bit数据，数据压缩16-bit，32-bit 数据，40-bit数据和64-bit数据.值大于32 bits,如40-bit-long或64-bit-long值
存储在寄存器对，随着放置在更寄存器数据32 LSBs，其余8或 32 MSBs在未来上寄存器（总是奇数寄存器）.
八(.M1, .L1, .D1, .S1, .M2, .L2, .D2,和.S2)功能单位是每个有能力执行一 每个时钟周期的指令.该.M职能单位执行所有乘法运算.单位的.S和.L 执行算术，逻辑一般设置和分支功能.该.D单位主要负荷数据 从内存到内存寄存器文件寄存器文件和存储结果.
Each C674x .M单位可以执行下列其中一个每个时钟周期：一32 x 32位相乘，一16 x 32位相乘，二16 x 16位乘法，两个16 x 32位乘法，两个16 x 16位乘法和 加/减功能，四8 x 8位乘法，四8 x 8位乘法与添加操作，四 16 x 16乘与加/减功能（包括复杂的乘法）.也有支持 伽罗瓦 的8-bit和32-bit数据域乘法.许多通信和算法，如FFTs 调制解调器需要复杂的乘法.复杂的乘法(CMPY)需要输入指令16-bit 并产生一种32-bit真实与虚构32-bit输出.也有复杂的乘法与四舍五入 能力，产生一个32-bit包装输出，包含16-bit真实和16-bit虚值.该 32 x 32位乘法指令扩展精度提供了高精确度的算法必要的 一个符号和无符号32-bit各种数据类型.
该.L或（算术逻辑单元）结合的能力，现在做并行加法/减法操作上 对常见的输入.此指令的版本存在上班32-bit数据或对数据的16-bit 执行双16-bit添加和并行减去.也有饱和这些指令形式.
增强了核心的C674x于前几个.S内核的ways.单位，双16-bit MIN2和MAX2 比较是只在.L单位.在C674x核心它们也可用在.S单位 这增加了算法的性能做搜索和排序.最后，为了提高数据 包装和拆包吞吐量，.S单元可以持续的高性能的四8-bit/16-bit 和双16-bit指示.解压说明准备平行8-bit行动16-bit数据.包 并行指令返回结果输出精度，包括饱和的支持. 其他新功能包括： SPLOOP
-中的一个小的CPU aids指令流水线的软件创建循环缓冲区在 一个循环的多次迭代的并行执行.该SPLOOP缓冲降低了代码尺寸 与软件流水.此外，在SPLOOP缓冲区循环是完全中断. 紧凑型说明
-为C6000设备的原生指令长度是32 bits.许多常见的 如MPY,与，或，添加和SUB指令可以表示为16 bits如果C674x 编译器可以限制代码以使用在寄存器文件的特定寄存器.这种压缩是 执行的代码生成工具. 指令集增强
-如上所述，有新的指令，如32-bit
乘法运算，复数乘法，包装，分拣，位操作，并32-bit伽罗瓦场 乘法. 异常处理
-旨在帮助bugs.孤立的C674x CPU程序员能够
异常检测和响应，无论是从国内检测来源（如非法操作码）和 从系统事件（如看门狗时间到期）. 特权
-定义用户和业务主管模式，让作业系统提供一个 基层敏感资源的保护.本地内存被划分成多个页面，每个 读，写和执行权限